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GATES.circ
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<?xml version="1.0" encoding="UTF-8" standalone="no"?>
<project source="2.7.1" version="1.0">
This file is intended to be loaded by Logisim (http://www.cburch.com/logisim/).
<lib desc="#Wiring" name="0">
<tool name="Pull Resistor">
<a name="facing" val="east"/>
</tool>
</lib>
<lib desc="#Gates" name="1"/>
<lib desc="#Plexers" name="2"/>
<lib desc="#Arithmetic" name="3"/>
<lib desc="#Memory" name="4">
<tool name="ROM">
<a name="contents">addr/data: 8 8
0
</a>
</tool>
</lib>
<lib desc="#I/O" name="5"/>
<lib desc="#Base" name="6">
<tool name="Text Tool">
<a name="text" val=""/>
<a name="font" val="SansSerif plain 12"/>
<a name="halign" val="center"/>
<a name="valign" val="base"/>
</tool>
</lib>
<main name="main"/>
<options>
<a name="gateUndefined" val="ignore"/>
<a name="simlimit" val="1000"/>
<a name="simrand" val="0"/>
</options>
<mappings>
<tool lib="6" map="Button2" name="Menu Tool"/>
<tool lib="6" map="Button3" name="Menu Tool"/>
<tool lib="6" map="Ctrl Button1" name="Menu Tool"/>
</mappings>
<toolbar>
<tool lib="6" name="Poke Tool"/>
<tool lib="6" name="Edit Tool"/>
<tool lib="6" name="Text Tool">
<a name="text" val=""/>
<a name="font" val="SansSerif plain 12"/>
<a name="halign" val="center"/>
<a name="valign" val="base"/>
</tool>
<sep/>
<tool lib="0" name="Pin">
<a name="tristate" val="false"/>
</tool>
<tool lib="0" name="Pin">
<a name="facing" val="west"/>
<a name="output" val="true"/>
<a name="labelloc" val="east"/>
</tool>
<tool lib="1" name="NOT Gate"/>
<tool lib="1" name="AND Gate"/>
<tool lib="1" name="OR Gate"/>
</toolbar>
<circuit name="main">
<a name="circuit" val="main"/>
<a name="clabel" val=""/>
<a name="clabelup" val="east"/>
<a name="clabelfont" val="SansSerif plain 12"/>
<wire from="(310,150)" to="(340,150)"/>
<wire from="(310,50)" to="(340,50)"/>
<wire from="(190,150)" to="(190,160)"/>
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<wire from="(70,150)" to="(90,150)"/>
<wire from="(340,50)" to="(340,90)"/>
<wire from="(190,150)" to="(210,150)"/>
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<wire from="(310,30)" to="(310,50)"/>
<wire from="(340,130)" to="(340,150)"/>
<wire from="(280,70)" to="(290,70)"/>
<wire from="(340,150)" to="(350,150)"/>
<wire from="(160,70)" to="(170,70)"/>
<wire from="(160,110)" to="(170,110)"/>
<wire from="(70,30)" to="(70,50)"/>
<wire from="(40,70)" to="(50,70)"/>
<wire from="(190,30)" to="(190,50)"/>
<wire from="(190,130)" to="(190,150)"/>
<wire from="(310,90)" to="(310,150)"/>
<wire from="(280,110)" to="(320,110)"/>
<wire from="(70,90)" to="(70,150)"/>
<comp lib="5" loc="(90,150)" name="LED"/>
<comp lib="0" loc="(70,160)" name="Pull Resistor">
<a name="facing" val="north"/>
</comp>
<comp lib="5" loc="(350,150)" name="LED"/>
<comp lib="0" loc="(70,90)" name="Transistor">
<a name="facing" val="south"/>
</comp>
<comp lib="0" loc="(340,130)" name="Transistor">
<a name="type" val="n"/>
<a name="facing" val="south"/>
</comp>
<comp lib="0" loc="(310,160)" name="Pull Resistor">
<a name="facing" val="north"/>
</comp>
<comp lib="0" loc="(190,130)" name="Transistor">
<a name="type" val="n"/>
<a name="facing" val="south"/>
</comp>
<comp lib="0" loc="(70,30)" name="Constant">
<a name="facing" val="south"/>
</comp>
<comp lib="0" loc="(190,30)" name="Constant">
<a name="facing" val="south"/>
</comp>
<comp lib="0" loc="(310,90)" name="Transistor">
<a name="type" val="n"/>
<a name="facing" val="south"/>
</comp>
<comp lib="0" loc="(310,30)" name="Constant">
<a name="facing" val="south"/>
</comp>
<comp lib="0" loc="(190,160)" name="Pull Resistor">
<a name="facing" val="north"/>
</comp>
<comp lib="0" loc="(280,110)" name="Pin">
<a name="tristate" val="false"/>
</comp>
<comp lib="0" loc="(190,90)" name="Transistor">
<a name="type" val="n"/>
<a name="facing" val="south"/>
</comp>
<comp lib="0" loc="(280,70)" name="Pin">
<a name="tristate" val="false"/>
</comp>
<comp lib="0" loc="(40,70)" name="Pin">
<a name="tristate" val="false"/>
</comp>
<comp lib="0" loc="(160,110)" name="Pin">
<a name="tristate" val="false"/>
</comp>
<comp lib="5" loc="(210,150)" name="LED"/>
<comp lib="0" loc="(160,70)" name="Pin">
<a name="tristate" val="false"/>
</comp>
</circuit>
</project>