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TimeQuest Timing Analyzer report for vga_with_hw_test_image
Thu Dec 06 11:18:27 2018
Quartus Prime Version 16.1.0 Build 196 10/24/2016 SJ Lite Edition
---------------------
; Table of Contents ;
---------------------
1. Legal Notice
2. TimeQuest Timing Analyzer Summary
3. Parallel Compilation
4. SDC File List
5. Clocks
6. Slow 1200mV 85C Model Fmax Summary
7. Timing Closure Recommendations
8. Slow 1200mV 85C Model Setup Summary
9. Slow 1200mV 85C Model Hold Summary
10. Slow 1200mV 85C Model Recovery Summary
11. Slow 1200mV 85C Model Removal Summary
12. Slow 1200mV 85C Model Minimum Pulse Width Summary
13. Slow 1200mV 85C Model Setup: 'clk'
14. Slow 1200mV 85C Model Hold: 'clk'
15. Slow 1200mV 85C Model Metastability Summary
16. Slow 1200mV 0C Model Fmax Summary
17. Slow 1200mV 0C Model Setup Summary
18. Slow 1200mV 0C Model Hold Summary
19. Slow 1200mV 0C Model Recovery Summary
20. Slow 1200mV 0C Model Removal Summary
21. Slow 1200mV 0C Model Minimum Pulse Width Summary
22. Slow 1200mV 0C Model Setup: 'clk'
23. Slow 1200mV 0C Model Hold: 'clk'
24. Slow 1200mV 0C Model Metastability Summary
25. Fast 1200mV 0C Model Setup Summary
26. Fast 1200mV 0C Model Hold Summary
27. Fast 1200mV 0C Model Recovery Summary
28. Fast 1200mV 0C Model Removal Summary
29. Fast 1200mV 0C Model Minimum Pulse Width Summary
30. Fast 1200mV 0C Model Setup: 'clk'
31. Fast 1200mV 0C Model Hold: 'clk'
32. Fast 1200mV 0C Model Metastability Summary
33. Multicorner Timing Analysis Summary
34. Board Trace Model Assignments
35. Input Transition Times
36. Signal Integrity Metrics (Slow 1200mv 0c Model)
37. Signal Integrity Metrics (Slow 1200mv 85c Model)
38. Signal Integrity Metrics (Fast 1200mv 0c Model)
39. Setup Transfers
40. Hold Transfers
41. Report TCCS
42. Report RSKM
43. Unconstrained Paths Summary
44. Clock Status Summary
45. Unconstrained Input Ports
46. Unconstrained Output Ports
47. Unconstrained Input Ports
48. Unconstrained Output Ports
49. TimeQuest Timing Analyzer Messages
----------------
; Legal Notice ;
----------------
Copyright (C) 2016 Intel Corporation. All rights reserved.
Your use of Intel Corporation's design tools, logic functions
and other software and tools, and its AMPP partner logic
functions, and any output files from any of the foregoing
(including device programming or simulation files), and any
associated documentation or information are expressly subject
to the terms and conditions of the Intel Program License
Subscription Agreement, the Intel Quartus Prime License Agreement,
the Intel MegaCore Function License Agreement, or other
applicable license agreement, including, without limitation,
that your use is for the sole purpose of programming logic
devices manufactured by Intel and sold by Intel or its
authorized distributors. Please refer to the applicable
agreement for further details.
+-----------------------------------------------------------------------------+
; TimeQuest Timing Analyzer Summary ;
+-----------------------+-----------------------------------------------------+
; Quartus Prime Version ; Version 16.1.0 Build 196 10/24/2016 SJ Lite Edition ;
; Timing Analyzer ; TimeQuest ;
; Revision Name ; vga_with_hw_test_image ;
; Device Family ; Cyclone IV E ;
; Device Name ; EP4CE115F29C7 ;
; Timing Models ; Final ;
; Delay Model ; Combined ;
; Rise/Fall Delays ; Enabled ;
+-----------------------+-----------------------------------------------------+
+------------------------------------------+
; Parallel Compilation ;
+----------------------------+-------------+
; Processors ; Number ;
+----------------------------+-------------+
; Number detected on machine ; 8 ;
; Maximum allowed ; 4 ;
; ; ;
; Average used ; 1.01 ;
; Maximum used ; 4 ;
; ; ;
; Usage by Processor ; % Time Used ;
; Processor 1 ; 100.0% ;
; Processor 2 ; 0.3% ;
; Processors 3-4 ; 0.2% ;
+----------------------------+-------------+
+--------------------------------------------------------------------+
; SDC File List ;
+--------------------------------+--------+--------------------------+
; SDC File Path ; Status ; Read at ;
+--------------------------------+--------+--------------------------+
; vga_with_hw_test_image.out.sdc ; OK ; Thu Dec 06 11:18:21 2018 ;
+--------------------------------+--------+--------------------------+
+---------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Clocks ;
+------------+------+--------+-----------+-------+--------+------------+-----------+-------------+-------+--------+-----------+------------+----------+--------+--------+---------+
; Clock Name ; Type ; Period ; Frequency ; Rise ; Fall ; Duty Cycle ; Divide by ; Multiply by ; Phase ; Offset ; Edge List ; Edge Shift ; Inverted ; Master ; Source ; Targets ;
+------------+------+--------+-----------+-------+--------+------------+-----------+-------------+-------+--------+-----------+------------+----------+--------+--------+---------+
; clk ; Base ; 20.000 ; 50.0 MHz ; 0.000 ; 10.000 ; ; ; ; ; ; ; ; ; ; ; { clk } ;
+------------+------+--------+-----------+-------+--------+------------+-----------+-------------+-------+--------+-----------+------------+----------+--------+--------+---------+
+--------------------------------------------------+
; Slow 1200mV 85C Model Fmax Summary ;
+------------+-----------------+------------+------+
; Fmax ; Restricted Fmax ; Clock Name ; Note ;
+------------+-----------------+------------+------+
; 130.58 MHz ; 130.58 MHz ; clk ; ;
+------------+-----------------+------------+------+
This panel reports FMAX for every clock in the design, regardless of the user-specified clock periods. FMAX is only computed for paths where the source and destination registers or ports are driven by the same clock. Paths of different clocks, including generated clocks, are ignored. For paths between a clock and its inversion, FMAX is computed as if the rising and falling edges are scaled along with FMAX, such that the duty cycle (in terms of a percentage) is maintained. Altera recommends that you always use clock constraints and other slack reports for sign-off analysis.
----------------------------------
; Timing Closure Recommendations ;
----------------------------------
HTML report is unavailable in plain text report export.
+-------------------------------------+
; Slow 1200mV 85C Model Setup Summary ;
+-------+--------+--------------------+
; Clock ; Slack ; End Point TNS ;
+-------+--------+--------------------+
; clk ; 12.342 ; 0.000 ;
+-------+--------+--------------------+
+------------------------------------+
; Slow 1200mV 85C Model Hold Summary ;
+-------+-------+--------------------+
; Clock ; Slack ; End Point TNS ;
+-------+-------+--------------------+
; clk ; 0.404 ; 0.000 ;
+-------+-------+--------------------+
------------------------------------------
; Slow 1200mV 85C Model Recovery Summary ;
------------------------------------------
No paths to report.
-----------------------------------------
; Slow 1200mV 85C Model Removal Summary ;
-----------------------------------------
No paths to report.
+---------------------------------------------------+
; Slow 1200mV 85C Model Minimum Pulse Width Summary ;
+-------+-------+-----------------------------------+
; Clock ; Slack ; End Point TNS ;
+-------+-------+-----------------------------------+
; clk ; 9.681 ; 0.000 ;
+-------+-------+-----------------------------------+
+-------------------------------------------------------------------------------------------------------------------------------------------------------+
; Slow 1200mV 85C Model Setup: 'clk' ;
+--------+-------------------------------------+----------------------------------+--------------+-------------+--------------+------------+------------+
; Slack ; From Node ; To Node ; Launch Clock ; Latch Clock ; Relationship ; Clock Skew ; Data Delay ;
+--------+-------------------------------------+----------------------------------+--------------+-------------+--------------+------------+------------+
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; 0.404 ; vga_controller:b2v_inst1|v_count[0] ; vga_controller:b2v_inst1|v_count[0] ; clk ; clk ; 0.000 ; 0.079 ; 0.669 ;
; 0.405 ; Player:p1|S.STANDTHRUST ; Player:p1|S.STANDTHRUST ; clk ; clk ; 0.000 ; 0.078 ; 0.669 ;
; 0.405 ; Player:p1|S.LOSE ; Player:p1|S.LOSE ; clk ; clk ; 0.000 ; 0.078 ; 0.669 ;
; 0.405 ; Player:p1|S.CROUCHTHRUST ; Player:p1|S.CROUCHTHRUST ; clk ; clk ; 0.000 ; 0.078 ; 0.669 ;
; 0.936 ; Player:p2|S.CROUCH ; Player:p2|S.LOSE ; clk ; clk ; 0.000 ; 0.079 ; 1.201 ;
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; 1.068 ; Player:p1|S.STAND ; Player:p1|S.STANDTHRUST ; clk ; clk ; 0.000 ; 0.078 ; 1.332 ;
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; 1.152 ; Player:p2|S.CROUCH ; Player:p2|S.STAND ; clk ; clk ; 0.000 ; 0.079 ; 1.417 ;
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; 1.196 ; Player:p1|S.CROUCH ; Player:p1|S.CROUCH ; clk ; clk ; 0.000 ; 0.078 ; 1.460 ;
; 1.199 ; Player:p1|S.CROUCH ; Player:p1|S.STAND ; clk ; clk ; 0.000 ; 0.078 ; 1.463 ;
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; 1.256 ; vga_controller:b2v_inst1|h_count[0] ; vga_controller:b2v_inst1|h_count[0] ; clk ; clk ; 0.000 ; 0.078 ; 1.520 ;
; 1.271 ; Player:p1|S.STAND ; Player:p1|S.LOSE ; clk ; clk ; 0.000 ; 0.078 ; 1.535 ;
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; 1.304 ; Player:p1|S.STAND ; Player:p1|S.CROUCH ; clk ; clk ; 0.000 ; 0.078 ; 1.568 ;
; 1.307 ; vga_controller:b2v_inst1|h_count[1] ; vga_controller:b2v_inst1|h_count[2] ; clk ; clk ; 0.000 ; 0.078 ; 1.571 ;
; 1.319 ; Player:p2|S.CROUCH ; Player:p2|S.CROUCHTHRUST ; clk ; clk ; 0.000 ; 0.079 ; 1.584 ;
; 1.323 ; vga_controller:b2v_inst1|v_count[3] ; vga_controller:b2v_inst1|v_count[4] ; clk ; clk ; 0.000 ; 0.079 ; 1.588 ;
; 1.328 ; vga_controller:b2v_inst1|v_count[2] ; vga_controller:b2v_inst1|v_count[3] ; clk ; clk ; 0.000 ; 0.079 ; 1.593 ;
; 1.338 ; vga_controller:b2v_inst1|h_count[0] ; vga_controller:b2v_inst1|h_count[2] ; clk ; clk ; 0.000 ; 0.078 ; 1.602 ;
; 1.340 ; vga_controller:b2v_inst1|v_count[2] ; vga_controller:b2v_inst1|v_count[4] ; clk ; clk ; 0.000 ; 0.079 ; 1.605 ;
; 1.341 ; vga_controller:b2v_inst1|v_count[9] ; vga_controller:b2v_inst1|v_count[8] ; clk ; clk ; 0.000 ; 0.079 ; 1.606 ;
; 1.343 ; vga_controller:b2v_inst1|v_count[9] ; vga_controller:b2v_inst1|v_count[7] ; clk ; clk ; 0.000 ; 0.079 ; 1.608 ;
; 1.344 ; vga_controller:b2v_inst1|v_count[9] ; vga_controller:b2v_inst1|v_count[6] ; clk ; clk ; 0.000 ; 0.079 ; 1.609 ;
; 1.345 ; vga_controller:b2v_inst1|v_count[9] ; vga_controller:b2v_inst1|v_count[5] ; clk ; clk ; 0.000 ; 0.079 ; 1.610 ;
; 1.346 ; vga_controller:b2v_inst1|v_count[9] ; vga_controller:b2v_inst1|v_count[0] ; clk ; clk ; 0.000 ; 0.079 ; 1.611 ;
; 1.362 ; vga_controller:b2v_inst1|v_count[7] ; vga_controller:b2v_inst1|row[7] ; clk ; clk ; 0.000 ; 0.086 ; 1.634 ;
; 1.370 ; vga_controller:b2v_inst1|h_count[3] ; vga_controller:b2v_inst1|h_count[3] ; clk ; clk ; 0.000 ; 0.078 ; 1.634 ;
; 1.381 ; vga_controller:b2v_inst1|v_count[5] ; vga_controller:b2v_inst1|row[5] ; clk ; clk ; 0.000 ; 0.086 ; 1.653 ;
; 1.401 ; Player:p1|S.STAND ; Player:p1|S.STAND ; clk ; clk ; 0.000 ; 0.078 ; 1.665 ;
; 1.408 ; vga_controller:b2v_inst1|v_count[4] ; vga_controller:b2v_inst1|v_sync ; clk ; clk ; 0.000 ; 0.080 ; 1.674 ;
; 1.414 ; vga_controller:b2v_inst1|v_count[1] ; vga_controller:b2v_inst1|v_count[3] ; clk ; clk ; 0.000 ; 0.079 ; 1.679 ;
; 1.426 ; vga_controller:b2v_inst1|v_count[1] ; vga_controller:b2v_inst1|v_count[4] ; clk ; clk ; 0.000 ; 0.079 ; 1.691 ;
; 1.441 ; vga_controller:b2v_inst1|v_count[5] ; vga_controller:b2v_inst1|disp_ena ; clk ; clk ; 0.000 ; 0.080 ; 1.707 ;
; 1.449 ; Player:p2|S.STANDTHRUST ; Player:p2|S.STAND ; clk ; clk ; 0.000 ; 0.079 ; 1.714 ;
; 1.451 ; vga_controller:b2v_inst1|v_count[9] ; vga_controller:b2v_inst1|v_count[1] ; clk ; clk ; 0.000 ; 0.078 ; 1.715 ;
; 1.452 ; vga_controller:b2v_inst1|v_count[9] ; vga_controller:b2v_inst1|v_count[2] ; clk ; clk ; 0.000 ; 0.078 ; 1.716 ;
; 1.452 ; vga_controller:b2v_inst1|h_count[8] ; vga_controller:b2v_inst1|h_count[0] ; clk ; clk ; 0.000 ; 0.071 ; 1.709 ;
; 1.454 ; vga_controller:b2v_inst1|h_count[8] ; vga_controller:b2v_inst1|h_count[2] ; clk ; clk ; 0.000 ; 0.071 ; 1.711 ;
; 1.464 ; vga_controller:b2v_inst1|h_count[0] ; vga_controller:b2v_inst1|h_count[1] ; clk ; clk ; 0.000 ; 0.078 ; 1.728 ;
; 1.469 ; vga_controller:b2v_inst1|h_count[2] ; vga_controller:b2v_inst1|h_count[3] ; clk ; clk ; 0.000 ; 0.077 ; 1.732 ;
; 1.480 ; vga_controller:b2v_inst1|v_count[8] ; vga_controller:b2v_inst1|v_sync ; clk ; clk ; 0.000 ; 0.079 ; 1.745 ;
; 1.493 ; vga_controller:b2v_inst1|v_count[6] ; vga_controller:b2v_inst1|v_sync ; clk ; clk ; 0.000 ; 0.079 ; 1.758 ;
; 1.513 ; vga_controller:b2v_inst1|v_count[4] ; vga_controller:b2v_inst1|v_count[6] ; clk ; clk ; 0.000 ; 0.080 ; 1.779 ;
; 1.528 ; vga_controller:b2v_inst1|h_count[8] ; vga_controller:b2v_inst1|h_count[1] ; clk ; clk ; 0.000 ; 0.071 ; 1.785 ;
; 1.545 ; vga_controller:b2v_inst1|v_count[1] ; vga_controller:b2v_inst1|row[1] ; clk ; clk ; 0.000 ; 0.087 ; 1.818 ;
; 1.554 ; vga_controller:b2v_inst1|v_count[7] ; vga_controller:b2v_inst1|v_sync ; clk ; clk ; 0.000 ; 0.079 ; 1.819 ;
; 1.578 ; vga_controller:b2v_inst1|h_count[1] ; vga_controller:b2v_inst1|h_count[3] ; clk ; clk ; 0.000 ; 0.077 ; 1.841 ;
; 1.581 ; vga_controller:b2v_inst1|v_count[3] ; vga_controller:b2v_inst1|row[3] ; clk ; clk ; 0.000 ; 0.087 ; 1.854 ;
; 1.597 ; vga_controller:b2v_inst1|v_count[6] ; vga_controller:b2v_inst1|row[6] ; clk ; clk ; 0.000 ; 0.086 ; 1.869 ;
; 1.601 ; vga_controller:b2v_inst1|v_count[2] ; vga_controller:b2v_inst1|v_count[8] ; clk ; clk ; 0.000 ; 0.080 ; 1.867 ;
; 1.603 ; vga_controller:b2v_inst1|v_count[2] ; vga_controller:b2v_inst1|v_count[7] ; clk ; clk ; 0.000 ; 0.080 ; 1.869 ;
; 1.604 ; vga_controller:b2v_inst1|v_count[2] ; vga_controller:b2v_inst1|v_count[6] ; clk ; clk ; 0.000 ; 0.080 ; 1.870 ;
; 1.605 ; vga_controller:b2v_inst1|v_count[2] ; vga_controller:b2v_inst1|v_count[5] ; clk ; clk ; 0.000 ; 0.080 ; 1.871 ;
; 1.606 ; vga_controller:b2v_inst1|v_count[2] ; vga_controller:b2v_inst1|v_count[0] ; clk ; clk ; 0.000 ; 0.080 ; 1.872 ;
; 1.609 ; vga_controller:b2v_inst1|h_count[0] ; vga_controller:b2v_inst1|h_count[3] ; clk ; clk ; 0.000 ; 0.077 ; 1.872 ;
; 1.631 ; vga_controller:b2v_inst1|v_count[2] ; vga_controller:b2v_inst1|row[2] ; clk ; clk ; 0.000 ; 0.087 ; 1.904 ;
; 1.631 ; vga_controller:b2v_inst1|v_count[0] ; vga_controller:b2v_inst1|v_count[3] ; clk ; clk ; 0.000 ; 0.078 ; 1.895 ;
; 1.635 ; vga_controller:b2v_inst1|v_count[3] ; vga_controller:b2v_inst1|v_count[6] ; clk ; clk ; 0.000 ; 0.080 ; 1.901 ;
; 1.637 ; vga_controller:b2v_inst1|v_count[4] ; vga_controller:b2v_inst1|v_count[8] ; clk ; clk ; 0.000 ; 0.080 ; 1.903 ;
; 1.642 ; vga_controller:b2v_inst1|h_count[8] ; vga_controller:b2v_inst1|h_count[3] ; clk ; clk ; 0.000 ; 0.070 ; 1.898 ;
; 1.642 ; vga_controller:b2v_inst1|h_count[5] ; vga_controller:b2v_inst1|h_count[0] ; clk ; clk ; 0.000 ; 0.071 ; 1.899 ;
; 1.643 ; vga_controller:b2v_inst1|v_count[0] ; vga_controller:b2v_inst1|v_count[4] ; clk ; clk ; 0.000 ; 0.078 ; 1.907 ;
; 1.643 ; vga_controller:b2v_inst1|h_count[5] ; vga_controller:b2v_inst1|h_count[2] ; clk ; clk ; 0.000 ; 0.071 ; 1.900 ;
; 1.664 ; vga_controller:b2v_inst1|v_count[8] ; vga_controller:b2v_inst1|disp_ena ; clk ; clk ; 0.000 ; 0.080 ; 1.930 ;
; 1.668 ; vga_controller:b2v_inst1|v_count[6] ; vga_controller:b2v_inst1|v_count[8] ; clk ; clk ; 0.000 ; 0.079 ; 1.933 ;
; 1.671 ; vga_controller:b2v_inst1|v_count[9] ; vga_controller:b2v_inst1|v_count[9] ; clk ; clk ; 0.000 ; 0.079 ; 1.936 ;
; 1.671 ; vga_controller:b2v_inst1|v_count[7] ; vga_controller:b2v_inst1|v_count[8] ; clk ; clk ; 0.000 ; 0.079 ; 1.936 ;
; 1.672 ; vga_controller:b2v_inst1|v_count[9] ; vga_controller:b2v_inst1|disp_ena ; clk ; clk ; 0.000 ; 0.080 ; 1.938 ;
; 1.674 ; vga_controller:b2v_inst1|v_count[4] ; vga_controller:b2v_inst1|v_count[5] ; clk ; clk ; 0.000 ; 0.080 ; 1.940 ;
; 1.677 ; vga_controller:b2v_inst1|v_count[6] ; vga_controller:b2v_inst1|disp_ena ; clk ; clk ; 0.000 ; 0.080 ; 1.943 ;
; 1.684 ; vga_controller:b2v_inst1|v_count[9] ; vga_controller:b2v_inst1|v_count[4] ; clk ; clk ; 0.000 ; 0.078 ; 1.948 ;
; 1.685 ; vga_controller:b2v_inst1|v_count[9] ; vga_controller:b2v_inst1|v_count[3] ; clk ; clk ; 0.000 ; 0.078 ; 1.949 ;
; 1.686 ; vga_controller:b2v_inst1|v_count[7] ; vga_controller:b2v_inst1|v_count[6] ; clk ; clk ; 0.000 ; 0.079 ; 1.951 ;
; 1.687 ; vga_controller:b2v_inst1|v_count[7] ; vga_controller:b2v_inst1|v_count[5] ; clk ; clk ; 0.000 ; 0.079 ; 1.952 ;
; 1.688 ; vga_controller:b2v_inst1|v_count[1] ; vga_controller:b2v_inst1|v_count[2] ; clk ; clk ; 0.000 ; 0.079 ; 1.953 ;
; 1.688 ; vga_controller:b2v_inst1|v_count[7] ; vga_controller:b2v_inst1|v_count[0] ; clk ; clk ; 0.000 ; 0.079 ; 1.953 ;
; 1.690 ; vga_controller:b2v_inst1|v_count[4] ; vga_controller:b2v_inst1|row[4] ; clk ; clk ; 0.000 ; 0.087 ; 1.963 ;
; 1.696 ; vga_controller:b2v_inst1|v_count[5] ; vga_controller:b2v_inst1|v_count[6] ; clk ; clk ; 0.000 ; 0.079 ; 1.961 ;
; 1.711 ; vga_controller:b2v_inst1|v_count[2] ; vga_controller:b2v_inst1|v_count[1] ; clk ; clk ; 0.000 ; 0.079 ; 1.976 ;
; 1.718 ; vga_controller:b2v_inst1|h_count[5] ; vga_controller:b2v_inst1|h_count[1] ; clk ; clk ; 0.000 ; 0.071 ; 1.975 ;
+-------+-------------------------------------+-------------------------------------+--------------+-------------+--------------+------------+------------+
-----------------------------------------------
; Slow 1200mV 85C Model Metastability Summary ;
-----------------------------------------------
No synchronizer chains to report.
+--------------------------------------------------+
; Slow 1200mV 0C Model Fmax Summary ;
+------------+-----------------+------------+------+
; Fmax ; Restricted Fmax ; Clock Name ; Note ;
+------------+-----------------+------------+------+
; 143.16 MHz ; 143.16 MHz ; clk ; ;
+------------+-----------------+------------+------+
This panel reports FMAX for every clock in the design, regardless of the user-specified clock periods. FMAX is only computed for paths where the source and destination registers or ports are driven by the same clock. Paths of different clocks, including generated clocks, are ignored. For paths between a clock and its inversion, FMAX is computed as if the rising and falling edges are scaled along with FMAX, such that the duty cycle (in terms of a percentage) is maintained. Altera recommends that you always use clock constraints and other slack reports for sign-off analysis.
+------------------------------------+
; Slow 1200mV 0C Model Setup Summary ;
+-------+--------+-------------------+
; Clock ; Slack ; End Point TNS ;
+-------+--------+-------------------+
; clk ; 13.015 ; 0.000 ;
+-------+--------+-------------------+
+-----------------------------------+
; Slow 1200mV 0C Model Hold Summary ;
+-------+-------+-------------------+
; Clock ; Slack ; End Point TNS ;
+-------+-------+-------------------+
; clk ; 0.355 ; 0.000 ;
+-------+-------+-------------------+
-----------------------------------------
; Slow 1200mV 0C Model Recovery Summary ;
-----------------------------------------
No paths to report.
----------------------------------------
; Slow 1200mV 0C Model Removal Summary ;
----------------------------------------
No paths to report.
+--------------------------------------------------+
; Slow 1200mV 0C Model Minimum Pulse Width Summary ;
+-------+-------+----------------------------------+
; Clock ; Slack ; End Point TNS ;
+-------+-------+----------------------------------+
; clk ; 9.682 ; 0.000 ;
+-------+-------+----------------------------------+
+-------------------------------------------------------------------------------------------------------------------------------------------------------+
; Slow 1200mV 0C Model Setup: 'clk' ;
+--------+-------------------------------------+----------------------------------+--------------+-------------+--------------+------------+------------+
; Slack ; From Node ; To Node ; Launch Clock ; Latch Clock ; Relationship ; Clock Skew ; Data Delay ;
+--------+-------------------------------------+----------------------------------+--------------+-------------+--------------+------------+------------+
; 13.015 ; vga_controller:b2v_inst1|h_count[4] ; vga_controller:b2v_inst1|row[1] ; clk ; clk ; 20.000 ; -0.071 ; 6.833 ;
; 13.015 ; vga_controller:b2v_inst1|h_count[4] ; vga_controller:b2v_inst1|row[2] ; clk ; clk ; 20.000 ; -0.071 ; 6.833 ;
; 13.015 ; vga_controller:b2v_inst1|h_count[4] ; vga_controller:b2v_inst1|row[3] ; clk ; clk ; 20.000 ; -0.071 ; 6.833 ;
; 13.015 ; vga_controller:b2v_inst1|h_count[4] ; vga_controller:b2v_inst1|row[4] ; clk ; clk ; 20.000 ; -0.071 ; 6.833 ;
; 13.015 ; vga_controller:b2v_inst1|h_count[4] ; vga_controller:b2v_inst1|row[5] ; clk ; clk ; 20.000 ; -0.071 ; 6.833 ;
; 13.015 ; vga_controller:b2v_inst1|h_count[4] ; vga_controller:b2v_inst1|row[6] ; clk ; clk ; 20.000 ; -0.071 ; 6.833 ;
; 13.015 ; vga_controller:b2v_inst1|h_count[4] ; vga_controller:b2v_inst1|row[7] ; clk ; clk ; 20.000 ; -0.071 ; 6.833 ;
; 13.015 ; vga_controller:b2v_inst1|h_count[4] ; vga_controller:b2v_inst1|row[8] ; clk ; clk ; 20.000 ; -0.071 ; 6.833 ;
; 13.015 ; vga_controller:b2v_inst1|h_count[4] ; vga_controller:b2v_inst1|row[31] ; clk ; clk ; 20.000 ; -0.071 ; 6.833 ;
; 13.015 ; vga_controller:b2v_inst1|h_count[4] ; vga_controller:b2v_inst1|row[0] ; clk ; clk ; 20.000 ; -0.071 ; 6.833 ;
; 13.349 ; vga_controller:b2v_inst1|h_count[3] ; vga_controller:b2v_inst1|row[1] ; clk ; clk ; 20.000 ; -0.065 ; 6.505 ;
; 13.349 ; vga_controller:b2v_inst1|h_count[3] ; vga_controller:b2v_inst1|row[2] ; clk ; clk ; 20.000 ; -0.065 ; 6.505 ;
; 13.349 ; vga_controller:b2v_inst1|h_count[3] ; vga_controller:b2v_inst1|row[3] ; clk ; clk ; 20.000 ; -0.065 ; 6.505 ;
; 13.349 ; vga_controller:b2v_inst1|h_count[3] ; vga_controller:b2v_inst1|row[4] ; clk ; clk ; 20.000 ; -0.065 ; 6.505 ;
; 13.349 ; vga_controller:b2v_inst1|h_count[3] ; vga_controller:b2v_inst1|row[5] ; clk ; clk ; 20.000 ; -0.065 ; 6.505 ;
; 13.349 ; vga_controller:b2v_inst1|h_count[3] ; vga_controller:b2v_inst1|row[6] ; clk ; clk ; 20.000 ; -0.065 ; 6.505 ;
; 13.349 ; vga_controller:b2v_inst1|h_count[3] ; vga_controller:b2v_inst1|row[7] ; clk ; clk ; 20.000 ; -0.065 ; 6.505 ;
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; 13.349 ; vga_controller:b2v_inst1|h_count[3] ; vga_controller:b2v_inst1|row[31] ; clk ; clk ; 20.000 ; -0.065 ; 6.505 ;
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; 1.452 ; vga_controller:b2v_inst1|v_count[2] ; vga_controller:b2v_inst1|v_count[8] ; clk ; clk ; 0.000 ; 0.070 ; 1.693 ;
; 1.454 ; vga_controller:b2v_inst1|v_count[2] ; vga_controller:b2v_inst1|v_count[7] ; clk ; clk ; 0.000 ; 0.070 ; 1.695 ;
; 1.455 ; vga_controller:b2v_inst1|v_count[2] ; vga_controller:b2v_inst1|v_count[6] ; clk ; clk ; 0.000 ; 0.070 ; 1.696 ;
; 1.456 ; vga_controller:b2v_inst1|v_count[2] ; vga_controller:b2v_inst1|v_count[5] ; clk ; clk ; 0.000 ; 0.070 ; 1.697 ;
; 1.456 ; vga_controller:b2v_inst1|v_count[2] ; vga_controller:b2v_inst1|v_count[0] ; clk ; clk ; 0.000 ; 0.070 ; 1.697 ;
; 1.461 ; vga_controller:b2v_inst1|v_count[2] ; vga_controller:b2v_inst1|row[2] ; clk ; clk ; 0.000 ; 0.078 ; 1.710 ;
; 1.467 ; vga_controller:b2v_inst1|v_count[4] ; vga_controller:b2v_inst1|v_count[8] ; clk ; clk ; 0.000 ; 0.070 ; 1.708 ;
; 1.468 ; vga_controller:b2v_inst1|v_count[3] ; vga_controller:b2v_inst1|v_count[6] ; clk ; clk ; 0.000 ; 0.070 ; 1.709 ;
; 1.477 ; vga_controller:b2v_inst1|v_count[0] ; vga_controller:b2v_inst1|v_count[3] ; clk ; clk ; 0.000 ; 0.070 ; 1.718 ;
; 1.484 ; vga_controller:b2v_inst1|h_count[5] ; vga_controller:b2v_inst1|h_count[2] ; clk ; clk ; 0.000 ; 0.065 ; 1.720 ;
; 1.484 ; vga_controller:b2v_inst1|h_count[5] ; vga_controller:b2v_inst1|h_count[0] ; clk ; clk ; 0.000 ; 0.065 ; 1.720 ;
; 1.500 ; vga_controller:b2v_inst1|h_count[8] ; vga_controller:b2v_inst1|h_count[3] ; clk ; clk ; 0.000 ; 0.064 ; 1.735 ;
; 1.503 ; vga_controller:b2v_inst1|v_count[4] ; vga_controller:b2v_inst1|v_count[5] ; clk ; clk ; 0.000 ; 0.070 ; 1.744 ;
; 1.507 ; vga_controller:b2v_inst1|v_count[0] ; vga_controller:b2v_inst1|v_count[4] ; clk ; clk ; 0.000 ; 0.070 ; 1.748 ;
; 1.509 ; vga_controller:b2v_inst1|v_count[6] ; vga_controller:b2v_inst1|v_count[8] ; clk ; clk ; 0.000 ; 0.070 ; 1.750 ;
; 1.511 ; vga_controller:b2v_inst1|v_count[9] ; vga_controller:b2v_inst1|v_count[4] ; clk ; clk ; 0.000 ; 0.070 ; 1.752 ;
; 1.511 ; vga_controller:b2v_inst1|v_count[9] ; vga_controller:b2v_inst1|disp_ena ; clk ; clk ; 0.000 ; 0.071 ; 1.753 ;
; 1.512 ; vga_controller:b2v_inst1|v_count[9] ; vga_controller:b2v_inst1|v_count[3] ; clk ; clk ; 0.000 ; 0.070 ; 1.753 ;
; 1.514 ; vga_controller:b2v_inst1|v_count[4] ; vga_controller:b2v_inst1|row[4] ; clk ; clk ; 0.000 ; 0.078 ; 1.763 ;
; 1.514 ; vga_controller:b2v_inst1|v_count[7] ; vga_controller:b2v_inst1|v_count[8] ; clk ; clk ; 0.000 ; 0.070 ; 1.755 ;
; 1.516 ; vga_controller:b2v_inst1|v_count[8] ; vga_controller:b2v_inst1|disp_ena ; clk ; clk ; 0.000 ; 0.071 ; 1.758 ;
; 1.517 ; vga_controller:b2v_inst1|v_count[6] ; vga_controller:b2v_inst1|disp_ena ; clk ; clk ; 0.000 ; 0.071 ; 1.759 ;
; 1.520 ; vga_controller:b2v_inst1|v_count[7] ; vga_controller:b2v_inst1|v_count[6] ; clk ; clk ; 0.000 ; 0.070 ; 1.761 ;
; 1.521 ; vga_controller:b2v_inst1|v_count[7] ; vga_controller:b2v_inst1|v_count[5] ; clk ; clk ; 0.000 ; 0.070 ; 1.762 ;
; 1.521 ; vga_controller:b2v_inst1|v_count[7] ; vga_controller:b2v_inst1|v_count[0] ; clk ; clk ; 0.000 ; 0.070 ; 1.762 ;
; 1.524 ; vga_controller:b2v_inst1|v_count[1] ; vga_controller:b2v_inst1|v_count[2] ; clk ; clk ; 0.000 ; 0.070 ; 1.765 ;
; 1.538 ; vga_controller:b2v_inst1|v_count[5] ; vga_controller:b2v_inst1|v_count[6] ; clk ; clk ; 0.000 ; 0.070 ; 1.779 ;
; 1.541 ; vga_controller:b2v_inst1|v_count[7] ; vga_controller:b2v_inst1|disp_ena ; clk ; clk ; 0.000 ; 0.071 ; 1.783 ;
; 1.542 ; vga_controller:b2v_inst1|v_count[9] ; vga_controller:b2v_inst1|v_count[9] ; clk ; clk ; 0.000 ; 0.070 ; 1.783 ;
; 1.544 ; vga_controller:b2v_inst1|v_count[2] ; vga_controller:b2v_inst1|v_count[1] ; clk ; clk ; 0.000 ; 0.070 ; 1.785 ;
+-------+-------------------------------------+-------------------------------------+--------------+-------------+--------------+------------+------------+
----------------------------------------------
; Slow 1200mV 0C Model Metastability Summary ;
----------------------------------------------
No synchronizer chains to report.
+------------------------------------+
; Fast 1200mV 0C Model Setup Summary ;
+-------+--------+-------------------+
; Clock ; Slack ; End Point TNS ;
+-------+--------+-------------------+
; clk ; 16.135 ; 0.000 ;
+-------+--------+-------------------+
+-----------------------------------+
; Fast 1200mV 0C Model Hold Summary ;
+-------+-------+-------------------+
; Clock ; Slack ; End Point TNS ;
+-------+-------+-------------------+
; clk ; 0.183 ; 0.000 ;
+-------+-------+-------------------+
-----------------------------------------
; Fast 1200mV 0C Model Recovery Summary ;
-----------------------------------------
No paths to report.
----------------------------------------
; Fast 1200mV 0C Model Removal Summary ;
----------------------------------------
No paths to report.
+--------------------------------------------------+
; Fast 1200mV 0C Model Minimum Pulse Width Summary ;
+-------+-------+----------------------------------+
; Clock ; Slack ; End Point TNS ;
+-------+-------+----------------------------------+
; clk ; 9.217 ; 0.000 ;
+-------+-------+----------------------------------+
+-------------------------------------------------------------------------------------------------------------------------------------------------------+
; Fast 1200mV 0C Model Setup: 'clk' ;
+--------+-------------------------------------+----------------------------------+--------------+-------------+--------------+------------+------------+
; Slack ; From Node ; To Node ; Launch Clock ; Latch Clock ; Relationship ; Clock Skew ; Data Delay ;
+--------+-------------------------------------+----------------------------------+--------------+-------------+--------------+------------+------------+
; 16.135 ; vga_controller:b2v_inst1|h_count[4] ; vga_controller:b2v_inst1|row[1] ; clk ; clk ; 20.000 ; -0.040 ; 3.732 ;
; 16.135 ; vga_controller:b2v_inst1|h_count[4] ; vga_controller:b2v_inst1|row[2] ; clk ; clk ; 20.000 ; -0.040 ; 3.732 ;
; 16.135 ; vga_controller:b2v_inst1|h_count[4] ; vga_controller:b2v_inst1|row[3] ; clk ; clk ; 20.000 ; -0.040 ; 3.732 ;
; 16.135 ; vga_controller:b2v_inst1|h_count[4] ; vga_controller:b2v_inst1|row[4] ; clk ; clk ; 20.000 ; -0.040 ; 3.732 ;
; 16.135 ; vga_controller:b2v_inst1|h_count[4] ; vga_controller:b2v_inst1|row[5] ; clk ; clk ; 20.000 ; -0.040 ; 3.732 ;
; 16.135 ; vga_controller:b2v_inst1|h_count[4] ; vga_controller:b2v_inst1|row[6] ; clk ; clk ; 20.000 ; -0.040 ; 3.732 ;
; 16.135 ; vga_controller:b2v_inst1|h_count[4] ; vga_controller:b2v_inst1|row[7] ; clk ; clk ; 20.000 ; -0.040 ; 3.732 ;
; 16.135 ; vga_controller:b2v_inst1|h_count[4] ; vga_controller:b2v_inst1|row[8] ; clk ; clk ; 20.000 ; -0.040 ; 3.732 ;
; 16.135 ; vga_controller:b2v_inst1|h_count[4] ; vga_controller:b2v_inst1|row[31] ; clk ; clk ; 20.000 ; -0.040 ; 3.732 ;
; 16.135 ; vga_controller:b2v_inst1|h_count[4] ; vga_controller:b2v_inst1|row[0] ; clk ; clk ; 20.000 ; -0.040 ; 3.732 ;
; 16.326 ; vga_controller:b2v_inst1|h_count[3] ; vga_controller:b2v_inst1|row[1] ; clk ; clk ; 20.000 ; -0.032 ; 3.549 ;
; 16.326 ; vga_controller:b2v_inst1|h_count[3] ; vga_controller:b2v_inst1|row[2] ; clk ; clk ; 20.000 ; -0.032 ; 3.549 ;
; 16.326 ; vga_controller:b2v_inst1|h_count[3] ; vga_controller:b2v_inst1|row[3] ; clk ; clk ; 20.000 ; -0.032 ; 3.549 ;
; 16.326 ; vga_controller:b2v_inst1|h_count[3] ; vga_controller:b2v_inst1|row[4] ; clk ; clk ; 20.000 ; -0.032 ; 3.549 ;
; 16.326 ; vga_controller:b2v_inst1|h_count[3] ; vga_controller:b2v_inst1|row[5] ; clk ; clk ; 20.000 ; -0.032 ; 3.549 ;
; 16.326 ; vga_controller:b2v_inst1|h_count[3] ; vga_controller:b2v_inst1|row[6] ; clk ; clk ; 20.000 ; -0.032 ; 3.549 ;
; 16.326 ; vga_controller:b2v_inst1|h_count[3] ; vga_controller:b2v_inst1|row[7] ; clk ; clk ; 20.000 ; -0.032 ; 3.549 ;
; 16.326 ; vga_controller:b2v_inst1|h_count[3] ; vga_controller:b2v_inst1|row[8] ; clk ; clk ; 20.000 ; -0.032 ; 3.549 ;
; 16.326 ; vga_controller:b2v_inst1|h_count[3] ; vga_controller:b2v_inst1|row[31] ; clk ; clk ; 20.000 ; -0.032 ; 3.549 ;
; 16.326 ; vga_controller:b2v_inst1|h_count[3] ; vga_controller:b2v_inst1|row[0] ; clk ; clk ; 20.000 ; -0.032 ; 3.549 ;
; 16.337 ; vga_controller:b2v_inst1|h_count[2] ; vga_controller:b2v_inst1|row[1] ; clk ; clk ; 20.000 ; -0.033 ; 3.537 ;
; 16.337 ; vga_controller:b2v_inst1|h_count[2] ; vga_controller:b2v_inst1|row[2] ; clk ; clk ; 20.000 ; -0.033 ; 3.537 ;
; 16.337 ; vga_controller:b2v_inst1|h_count[2] ; vga_controller:b2v_inst1|row[3] ; clk ; clk ; 20.000 ; -0.033 ; 3.537 ;
; 16.337 ; vga_controller:b2v_inst1|h_count[2] ; vga_controller:b2v_inst1|row[4] ; clk ; clk ; 20.000 ; -0.033 ; 3.537 ;
; 16.337 ; vga_controller:b2v_inst1|h_count[2] ; vga_controller:b2v_inst1|row[5] ; clk ; clk ; 20.000 ; -0.033 ; 3.537 ;
; 16.337 ; vga_controller:b2v_inst1|h_count[2] ; vga_controller:b2v_inst1|row[6] ; clk ; clk ; 20.000 ; -0.033 ; 3.537 ;
; 16.337 ; vga_controller:b2v_inst1|h_count[2] ; vga_controller:b2v_inst1|row[7] ; clk ; clk ; 20.000 ; -0.033 ; 3.537 ;
; 16.337 ; vga_controller:b2v_inst1|h_count[2] ; vga_controller:b2v_inst1|row[8] ; clk ; clk ; 20.000 ; -0.033 ; 3.537 ;
; 16.337 ; vga_controller:b2v_inst1|h_count[2] ; vga_controller:b2v_inst1|row[31] ; clk ; clk ; 20.000 ; -0.033 ; 3.537 ;
; 16.337 ; vga_controller:b2v_inst1|h_count[2] ; vga_controller:b2v_inst1|row[0] ; clk ; clk ; 20.000 ; -0.033 ; 3.537 ;
; 16.342 ; vga_controller:b2v_inst1|h_count[1] ; vga_controller:b2v_inst1|row[1] ; clk ; clk ; 20.000 ; -0.033 ; 3.532 ;
; 16.342 ; vga_controller:b2v_inst1|h_count[1] ; vga_controller:b2v_inst1|row[2] ; clk ; clk ; 20.000 ; -0.033 ; 3.532 ;
; 16.342 ; vga_controller:b2v_inst1|h_count[1] ; vga_controller:b2v_inst1|row[3] ; clk ; clk ; 20.000 ; -0.033 ; 3.532 ;
; 16.342 ; vga_controller:b2v_inst1|h_count[1] ; vga_controller:b2v_inst1|row[4] ; clk ; clk ; 20.000 ; -0.033 ; 3.532 ;
; 16.342 ; vga_controller:b2v_inst1|h_count[1] ; vga_controller:b2v_inst1|row[5] ; clk ; clk ; 20.000 ; -0.033 ; 3.532 ;
; 16.342 ; vga_controller:b2v_inst1|h_count[1] ; vga_controller:b2v_inst1|row[6] ; clk ; clk ; 20.000 ; -0.033 ; 3.532 ;
; 16.342 ; vga_controller:b2v_inst1|h_count[1] ; vga_controller:b2v_inst1|row[7] ; clk ; clk ; 20.000 ; -0.033 ; 3.532 ;
; 16.342 ; vga_controller:b2v_inst1|h_count[1] ; vga_controller:b2v_inst1|row[8] ; clk ; clk ; 20.000 ; -0.033 ; 3.532 ;
; 16.342 ; vga_controller:b2v_inst1|h_count[1] ; vga_controller:b2v_inst1|row[31] ; clk ; clk ; 20.000 ; -0.033 ; 3.532 ;
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+---------------------------------------------------------------------------------------------------------------------------------------------------------+
; Fast 1200mV 0C Model Hold: 'clk' ;
+-------+-------------------------------------+-------------------------------------+--------------+-------------+--------------+------------+------------+
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; 0.680 ; vga_controller:b2v_inst1|v_count[6] ; vga_controller:b2v_inst1|v_sync ; clk ; clk ; 0.000 ; 0.040 ; 0.804 ;
; 0.681 ; vga_controller:b2v_inst1|h_count[2] ; vga_controller:b2v_inst1|h_count[3] ; clk ; clk ; 0.000 ; 0.039 ; 0.804 ;
; 0.687 ; vga_controller:b2v_inst1|v_count[4] ; vga_controller:b2v_inst1|v_count[6] ; clk ; clk ; 0.000 ; 0.041 ; 0.812 ;
; 0.691 ; vga_controller:b2v_inst1|h_count[8] ; vga_controller:b2v_inst1|h_count[0] ; clk ; clk ; 0.000 ; 0.032 ; 0.807 ;
; 0.692 ; vga_controller:b2v_inst1|h_count[8] ; vga_controller:b2v_inst1|h_count[2] ; clk ; clk ; 0.000 ; 0.032 ; 0.808 ;
; 0.698 ; vga_controller:b2v_inst1|v_count[7] ; vga_controller:b2v_inst1|v_sync ; clk ; clk ; 0.000 ; 0.040 ; 0.822 ;
; 0.709 ; vga_controller:b2v_inst1|v_count[9] ; vga_controller:b2v_inst1|v_count[1] ; clk ; clk ; 0.000 ; 0.039 ; 0.832 ;
; 0.711 ; vga_controller:b2v_inst1|v_count[9] ; vga_controller:b2v_inst1|v_count[2] ; clk ; clk ; 0.000 ; 0.039 ; 0.834 ;
; 0.712 ; vga_controller:b2v_inst1|v_count[1] ; vga_controller:b2v_inst1|row[1] ; clk ; clk ; 0.000 ; 0.045 ; 0.841 ;
; 0.724 ; vga_controller:b2v_inst1|v_count[3] ; vga_controller:b2v_inst1|row[3] ; clk ; clk ; 0.000 ; 0.045 ; 0.853 ;
; 0.731 ; vga_controller:b2v_inst1|h_count[8] ; vga_controller:b2v_inst1|h_count[1] ; clk ; clk ; 0.000 ; 0.032 ; 0.847 ;
; 0.734 ; vga_controller:b2v_inst1|v_count[6] ; vga_controller:b2v_inst1|row[6] ; clk ; clk ; 0.000 ; 0.044 ; 0.862 ;
; 0.735 ; vga_controller:b2v_inst1|h_count[1] ; vga_controller:b2v_inst1|h_count[3] ; clk ; clk ; 0.000 ; 0.039 ; 0.858 ;
; 0.744 ; vga_controller:b2v_inst1|v_count[2] ; vga_controller:b2v_inst1|row[2] ; clk ; clk ; 0.000 ; 0.045 ; 0.873 ;
; 0.746 ; vga_controller:b2v_inst1|v_count[9] ; vga_controller:b2v_inst1|v_count[9] ; clk ; clk ; 0.000 ; 0.040 ; 0.870 ;
; 0.746 ; vga_controller:b2v_inst1|v_count[7] ; vga_controller:b2v_inst1|v_count[8] ; clk ; clk ; 0.000 ; 0.040 ; 0.870 ;
; 0.747 ; vga_controller:b2v_inst1|v_count[3] ; vga_controller:b2v_inst1|v_count[6] ; clk ; clk ; 0.000 ; 0.041 ; 0.872 ;
; 0.749 ; vga_controller:b2v_inst1|v_count[9] ; vga_controller:b2v_inst1|disp_ena ; clk ; clk ; 0.000 ; 0.041 ; 0.874 ;
; 0.749 ; vga_controller:b2v_inst1|v_count[0] ; vga_controller:b2v_inst1|v_count[3] ; clk ; clk ; 0.000 ; 0.039 ; 0.872 ;
; 0.750 ; vga_controller:b2v_inst1|v_count[8] ; vga_controller:b2v_inst1|disp_ena ; clk ; clk ; 0.000 ; 0.041 ; 0.875 ;
; 0.752 ; vga_controller:b2v_inst1|v_count[0] ; vga_controller:b2v_inst1|v_count[4] ; clk ; clk ; 0.000 ; 0.039 ; 0.875 ;
; 0.752 ; vga_controller:b2v_inst1|v_count[4] ; vga_controller:b2v_inst1|v_count[8] ; clk ; clk ; 0.000 ; 0.041 ; 0.877 ;
; 0.753 ; vga_controller:b2v_inst1|h_count[0] ; vga_controller:b2v_inst1|h_count[3] ; clk ; clk ; 0.000 ; 0.039 ; 0.876 ;
; 0.753 ; vga_controller:b2v_inst1|v_count[6] ; vga_controller:b2v_inst1|v_count[8] ; clk ; clk ; 0.000 ; 0.040 ; 0.877 ;
; 0.755 ; vga_controller:b2v_inst1|v_count[5] ; vga_controller:b2v_inst1|v_count[6] ; clk ; clk ; 0.000 ; 0.040 ; 0.879 ;
; 0.757 ; vga_controller:b2v_inst1|v_count[2] ; vga_controller:b2v_inst1|v_count[8] ; clk ; clk ; 0.000 ; 0.041 ; 0.882 ;
; 0.758 ; vga_controller:b2v_inst1|v_count[6] ; vga_controller:b2v_inst1|disp_ena ; clk ; clk ; 0.000 ; 0.041 ; 0.883 ;
; 0.759 ; vga_controller:b2v_inst1|v_count[2] ; vga_controller:b2v_inst1|v_count[6] ; clk ; clk ; 0.000 ; 0.041 ; 0.884 ;
; 0.760 ; vga_controller:b2v_inst1|v_count[2] ; vga_controller:b2v_inst1|v_count[7] ; clk ; clk ; 0.000 ; 0.041 ; 0.885 ;
; 0.762 ; vga_controller:b2v_inst1|h_count[5] ; vga_controller:b2v_inst1|h_count[0] ; clk ; clk ; 0.000 ; 0.032 ; 0.878 ;
; 0.763 ; vga_controller:b2v_inst1|v_count[2] ; vga_controller:b2v_inst1|v_count[5] ; clk ; clk ; 0.000 ; 0.041 ; 0.888 ;
; 0.763 ; vga_controller:b2v_inst1|v_count[2] ; vga_controller:b2v_inst1|v_count[0] ; clk ; clk ; 0.000 ; 0.041 ; 0.888 ;
; 0.763 ; vga_controller:b2v_inst1|h_count[5] ; vga_controller:b2v_inst1|h_count[2] ; clk ; clk ; 0.000 ; 0.032 ; 0.879 ;
; 0.766 ; vga_controller:b2v_inst1|v_count[1] ; vga_controller:b2v_inst1|v_count[2] ; clk ; clk ; 0.000 ; 0.040 ; 0.890 ;
; 0.776 ; vga_controller:b2v_inst1|v_count[7] ; vga_controller:b2v_inst1|disp_ena ; clk ; clk ; 0.000 ; 0.041 ; 0.901 ;
; 0.777 ; vga_controller:b2v_inst1|v_count[4] ; vga_controller:b2v_inst1|row[4] ; clk ; clk ; 0.000 ; 0.045 ; 0.906 ;
; 0.779 ; vga_controller:b2v_inst1|v_count[4] ; vga_controller:b2v_inst1|v_count[5] ; clk ; clk ; 0.000 ; 0.041 ; 0.904 ;
; 0.789 ; vga_controller:b2v_inst1|v_count[0] ; vga_controller:b2v_inst1|v_count[1] ; clk ; clk ; 0.000 ; 0.039 ; 0.912 ;
; 0.789 ; vga_controller:b2v_inst1|v_count[2] ; vga_controller:b2v_inst1|v_sync ; clk ; clk ; 0.000 ; 0.041 ; 0.914 ;
; 0.792 ; vga_controller:b2v_inst1|h_count[8] ; vga_controller:b2v_inst1|h_count[3] ; clk ; clk ; 0.000 ; 0.031 ; 0.907 ;
; 0.800 ; vga_controller:b2v_inst1|v_count[1] ; vga_controller:b2v_inst1|v_count[6] ; clk ; clk ; 0.000 ; 0.041 ; 0.925 ;
; 0.801 ; vga_controller:b2v_inst1|h_count[5] ; vga_controller:b2v_inst1|h_count[5] ; clk ; clk ; 0.000 ; 0.039 ; 0.924 ;
; 0.802 ; vga_controller:b2v_inst1|h_count[5] ; vga_controller:b2v_inst1|h_count[1] ; clk ; clk ; 0.000 ; 0.032 ; 0.918 ;
; 0.803 ; vga_controller:b2v_inst1|v_count[1] ; vga_controller:b2v_inst1|v_sync ; clk ; clk ; 0.000 ; 0.041 ; 0.928 ;
+-------+-------------------------------------+-------------------------------------+--------------+-------------+--------------+------------+------------+
----------------------------------------------
; Fast 1200mV 0C Model Metastability Summary ;
----------------------------------------------
No synchronizer chains to report.
+------------------------------------------------------------------------------+
; Multicorner Timing Analysis Summary ;
+------------------+--------+-------+----------+---------+---------------------+
; Clock ; Setup ; Hold ; Recovery ; Removal ; Minimum Pulse Width ;
+------------------+--------+-------+----------+---------+---------------------+
; Worst-case Slack ; 12.342 ; 0.183 ; N/A ; N/A ; 9.217 ;
; clk ; 12.342 ; 0.183 ; N/A ; N/A ; 9.217 ;
; Design-wide TNS ; 0.0 ; 0.0 ; 0.0 ; 0.0 ; 0.0 ;
; clk ; 0.000 ; 0.000 ; N/A ; N/A ; 0.000 ;
+------------------+--------+-------+----------+---------+---------------------+
+------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Board Trace Model Assignments ;
+---------------+--------------+-------------------+-------------------------+-------------------------+---------------+---------------------+----------------+------------------+--------+------------------+------------------------+------------------------+--------------+---------------+-----------------+-------+---------------------+--------------------+---------------+-----------------+-------------+
; Pin ; I/O Standard ; Near Tline Length ; Near Tline L per Length ; Near Tline C per Length ; Near Series R ; Near Differential R ; Near Pull-up R ; Near Pull-down R ; Near C ; Far Tline Length ; Far Tline L per Length ; Far Tline C per Length ; Far Series R ; Far Pull-up R ; Far Pull-down R ; Far C ; Termination Voltage ; Far Differential R ; EBD File Name ; EBD Signal Name ; EBD Far-end ;
+---------------+--------------+-------------------+-------------------------+-------------------------+---------------+---------------------+----------------+------------------+--------+------------------+------------------------+------------------------+--------------+---------------+-----------------+-------+---------------------+--------------------+---------------+-----------------+-------------+
; pixel_clk ; 3.3-V LVTTL ; 0 in ; 0 H/in ; 0 F/in ; short ; - ; open ; open ; open ; 0 in ; 0 H/in ; 0 F/in ; short ; open ; open ; open ; 0 V ; - ; n/a ; n/a ; n/a ;
; h_sync ; 3.3-V LVTTL ; 0 in ; 0 H/in ; 0 F/in ; short ; - ; open ; open ; open ; 0 in ; 0 H/in ; 0 F/in ; short ; open ; open ; open ; 0 V ; - ; n/a ; n/a ; n/a ;
; v_sync ; 3.3-V LVTTL ; 0 in ; 0 H/in ; 0 F/in ; short ; - ; open ; open ; open ; 0 in ; 0 H/in ; 0 F/in ; short ; open ; open ; open ; 0 V ; - ; n/a ; n/a ; n/a ;
; n_blank ; 3.3-V LVTTL ; 0 in ; 0 H/in ; 0 F/in ; short ; - ; open ; open ; open ; 0 in ; 0 H/in ; 0 F/in ; short ; open ; open ; open ; 0 V ; - ; n/a ; n/a ; n/a ;
; n_sync ; 3.3-V LVTTL ; 0 in ; 0 H/in ; 0 F/in ; short ; - ; open ; open ; open ; 0 in ; 0 H/in ; 0 F/in ; short ; open ; open ; open ; 0 V ; - ; n/a ; n/a ; n/a ;
; blue[0] ; 3.3-V LVTTL ; 0 in ; 0 H/in ; 0 F/in ; short ; - ; open ; open ; open ; 0 in ; 0 H/in ; 0 F/in ; short ; open ; open ; open ; 0 V ; - ; n/a ; n/a ; n/a ;
; blue[1] ; 3.3-V LVTTL ; 0 in ; 0 H/in ; 0 F/in ; short ; - ; open ; open ; open ; 0 in ; 0 H/in ; 0 F/in ; short ; open ; open ; open ; 0 V ; - ; n/a ; n/a ; n/a ;
; blue[2] ; 3.3-V LVTTL ; 0 in ; 0 H/in ; 0 F/in ; short ; - ; open ; open ; open ; 0 in ; 0 H/in ; 0 F/in ; short ; open ; open ; open ; 0 V ; - ; n/a ; n/a ; n/a ;
; blue[3] ; 3.3-V LVTTL ; 0 in ; 0 H/in ; 0 F/in ; short ; - ; open ; open ; open ; 0 in ; 0 H/in ; 0 F/in ; short ; open ; open ; open ; 0 V ; - ; n/a ; n/a ; n/a ;
; blue[4] ; 3.3-V LVTTL ; 0 in ; 0 H/in ; 0 F/in ; short ; - ; open ; open ; open ; 0 in ; 0 H/in ; 0 F/in ; short ; open ; open ; open ; 0 V ; - ; n/a ; n/a ; n/a ;
; blue[5] ; 3.3-V LVTTL ; 0 in ; 0 H/in ; 0 F/in ; short ; - ; open ; open ; open ; 0 in ; 0 H/in ; 0 F/in ; short ; open ; open ; open ; 0 V ; - ; n/a ; n/a ; n/a ;
; blue[6] ; 3.3-V LVTTL ; 0 in ; 0 H/in ; 0 F/in ; short ; - ; open ; open ; open ; 0 in ; 0 H/in ; 0 F/in ; short ; open ; open ; open ; 0 V ; - ; n/a ; n/a ; n/a ;
; blue[7] ; 3.3-V LVTTL ; 0 in ; 0 H/in ; 0 F/in ; short ; - ; open ; open ; open ; 0 in ; 0 H/in ; 0 F/in ; short ; open ; open ; open ; 0 V ; - ; n/a ; n/a ; n/a ;
; green[0] ; 3.3-V LVTTL ; 0 in ; 0 H/in ; 0 F/in ; short ; - ; open ; open ; open ; 0 in ; 0 H/in ; 0 F/in ; short ; open ; open ; open ; 0 V ; - ; n/a ; n/a ; n/a ;
; green[1] ; 3.3-V LVTTL ; 0 in ; 0 H/in ; 0 F/in ; short ; - ; open ; open ; open ; 0 in ; 0 H/in ; 0 F/in ; short ; open ; open ; open ; 0 V ; - ; n/a ; n/a ; n/a ;
; green[2] ; 3.3-V LVTTL ; 0 in ; 0 H/in ; 0 F/in ; short ; - ; open ; open ; open ; 0 in ; 0 H/in ; 0 F/in ; short ; open ; open ; open ; 0 V ; - ; n/a ; n/a ; n/a ;
; green[3] ; 3.3-V LVTTL ; 0 in ; 0 H/in ; 0 F/in ; short ; - ; open ; open ; open ; 0 in ; 0 H/in ; 0 F/in ; short ; open ; open ; open ; 0 V ; - ; n/a ; n/a ; n/a ;
; green[4] ; 3.3-V LVTTL ; 0 in ; 0 H/in ; 0 F/in ; short ; - ; open ; open ; open ; 0 in ; 0 H/in ; 0 F/in ; short ; open ; open ; open ; 0 V ; - ; n/a ; n/a ; n/a ;
; green[5] ; 3.3-V LVTTL ; 0 in ; 0 H/in ; 0 F/in ; short ; - ; open ; open ; open ; 0 in ; 0 H/in ; 0 F/in ; short ; open ; open ; open ; 0 V ; - ; n/a ; n/a ; n/a ;
; green[6] ; 3.3-V LVTTL ; 0 in ; 0 H/in ; 0 F/in ; short ; - ; open ; open ; open ; 0 in ; 0 H/in ; 0 F/in ; short ; open ; open ; open ; 0 V ; - ; n/a ; n/a ; n/a ;
; green[7] ; 3.3-V LVTTL ; 0 in ; 0 H/in ; 0 F/in ; short ; - ; open ; open ; open ; 0 in ; 0 H/in ; 0 F/in ; short ; open ; open ; open ; 0 V ; - ; n/a ; n/a ; n/a ;
; red[0] ; 3.3-V LVTTL ; 0 in ; 0 H/in ; 0 F/in ; short ; - ; open ; open ; open ; 0 in ; 0 H/in ; 0 F/in ; short ; open ; open ; open ; 0 V ; - ; n/a ; n/a ; n/a ;
; red[1] ; 3.3-V LVTTL ; 0 in ; 0 H/in ; 0 F/in ; short ; - ; open ; open ; open ; 0 in ; 0 H/in ; 0 F/in ; short ; open ; open ; open ; 0 V ; - ; n/a ; n/a ; n/a ;
; red[2] ; 3.3-V LVTTL ; 0 in ; 0 H/in ; 0 F/in ; short ; - ; open ; open ; open ; 0 in ; 0 H/in ; 0 F/in ; short ; open ; open ; open ; 0 V ; - ; n/a ; n/a ; n/a ;
; red[3] ; 3.3-V LVTTL ; 0 in ; 0 H/in ; 0 F/in ; short ; - ; open ; open ; open ; 0 in ; 0 H/in ; 0 F/in ; short ; open ; open ; open ; 0 V ; - ; n/a ; n/a ; n/a ;
; red[4] ; 3.3-V LVTTL ; 0 in ; 0 H/in ; 0 F/in ; short ; - ; open ; open ; open ; 0 in ; 0 H/in ; 0 F/in ; short ; open ; open ; open ; 0 V ; - ; n/a ; n/a ; n/a ;
; red[5] ; 3.3-V LVTTL ; 0 in ; 0 H/in ; 0 F/in ; short ; - ; open ; open ; open ; 0 in ; 0 H/in ; 0 F/in ; short ; open ; open ; open ; 0 V ; - ; n/a ; n/a ; n/a ;
; red[6] ; 3.3-V LVTTL ; 0 in ; 0 H/in ; 0 F/in ; short ; - ; open ; open ; open ; 0 in ; 0 H/in ; 0 F/in ; short ; open ; open ; open ; 0 V ; - ; n/a ; n/a ; n/a ;
; red[7] ; 3.3-V LVTTL ; 0 in ; 0 H/in ; 0 F/in ; short ; - ; open ; open ; open ; 0 in ; 0 H/in ; 0 F/in ; short ; open ; open ; open ; 0 V ; - ; n/a ; n/a ; n/a ;
; ~ALTERA_DCLK~ ; 3.3-V LVTTL ; 0 in ; 0 H/in ; 0 F/in ; short ; - ; open ; open ; open ; 0 in ; 0 H/in ; 0 F/in ; short ; open ; open ; open ; 0 V ; - ; n/a ; n/a ; n/a ;
; ~ALTERA_nCEO~ ; 3.3-V LVTTL ; 0 in ; 0 H/in ; 0 F/in ; short ; - ; open ; open ; open ; 0 in ; 0 H/in ; 0 F/in ; short ; open ; open ; open ; 0 V ; - ; n/a ; n/a ; n/a ;
+---------------+--------------+-------------------+-------------------------+-------------------------+---------------+---------------------+----------------+------------------+--------+------------------+------------------------+------------------------+--------------+---------------+-----------------+-------+---------------------+--------------------+---------------+-----------------+-------------+
+----------------------------------------------------------------------------+
; Input Transition Times ;
+-------------------------+--------------+-----------------+-----------------+
; Pin ; I/O Standard ; 10-90 Rise Time ; 90-10 Fall Time ;
+-------------------------+--------------+-----------------+-----------------+
; clk ; 3.3-V LVTTL ; 2640 ps ; 2640 ps ;
; ctrl[3] ; 3.3-V LVTTL ; 2640 ps ; 2640 ps ;
; ctrl[2] ; 3.3-V LVTTL ; 2640 ps ; 2640 ps ;
; rst ; 3.3-V LVTTL ; 2640 ps ; 2640 ps ;
; ctrl[1] ; 3.3-V LVTTL ; 2640 ps ; 2640 ps ;